Informações Adicionais - Etapa 5

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1 Informações Adicionais - Etapa 5
Laboratório de Organização e Arquitetura de Computadores Informações Adicionais - Etapa 5 PROFESSORES: Elmar Uwe Kurt Melcher Joseana Macêdo Fechine

2 Processador - Microinstruções
Peac5.v Lab. Org. e Arq. de Computadores - DSC-UFCG

3 Processador - Microinstruções
Peac5.v Lab. Org. e Arq. de Computadores - DSC-UFCG

4 Processador - Microinstruções
Configurar (carregar) a memória (peacm.sof) Java1.mif 0: 1022 % BIPUSH 22 % 1033 % BIPUSH 33 % 6000 % IADD NOP % ; Lab. Org. e Arq. de Computadores - DSC-UFCG

5 Processador - Microinstruções
Configurar (carregar) o processador (peac5.sof) mic1.mif Lab. Org. e Arq. de Computadores - DSC-UFCG

6 Processador - Microinstruções
Implementar a instrução 0x5F SWAP Troca de posição as duas palavras do topo da pilha Lab. Org. e Arq. de Computadores - DSC-UFCG

7 Processador - Microinstruções
mic1.mif swap1 MAR=SP-1; rd swap MAR=SP swap3 H=MDR; wr swap4 MDR=TOS swap MAR=SP-1; wr swap TOS = H; goto Main1 Lab. Org. e Arq. de Computadores - DSC-UFCG

8 Processador - Microinstruções
Configurar (carregar) a memória (peacm.sof) Java1.mif 0: 1022 % BIPUSH 22 % 1033 % BIPUSH 33 % 5F00 % SWAP NOP % ; Lab. Org. e Arq. de Computadores - DSC-UFCG

9 Processador - Microinstruções
Implementar a instrução 0x IFEQ deslocamento Retira da pilha a palavra do topo e desvia se ela for igual a zero O deslocamento é somado ao valor do endereço onde o código de operação está armazenado. Lab. Org. e Arq. de Computadores - DSC-UFCG

10 Processador - Microinstruções
mic1.mif ifeq1 MAR=SP=SP-1; rd ifeq OPC=TOS ifeq3 TOS=MDR ifeq4 Z=OPC; if(Z) goto T; else goto F T OPC=PC-1; fetch goto goto2 F PC=PC+1 F2 PC=PC+1; fetch F3 goto Main1 Lab. Org. e Arq. de Computadores - DSC-UFCG

11 Processador - Microinstruções
mic1.mif goto2 PC=PC+1; fetch goto3 H=MBR<<8 goto4 H=MBRU OR H goto5 PC=OPC+H; fetch goto6 goto Main1 Lab. Org. e Arq. de Computadores - DSC-UFCG

12 Processador - Microinstruções
Java1.mif 0: 1022 % BIPUSH 22 % 9912 % IFEQ atual+1234 % 3410 0099 % BIPUSH 00 % 1234 % IFEQ atual+1234 % ; Lab. Org. e Arq. de Computadores - DSC-UFCG