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O latch RS SRQ N+1 (Q N+1 ) inv 00QNQN (Q N ) inv 0101 1010 1100 TABELA DE TRANSIÇÃO DE ESTADOS.

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1 O latch RS SRQ N+1 (Q N+1 ) inv 00QNQN (Q N ) inv TABELA DE TRANSIÇÃO DE ESTADOS

2 O latch RS/Outras implementações Teoremas de DeMorgan: Um matemático chamado De Morgan desenvolveu um par de regras complementares usadas para converter a operação OU em E e vice versa. Teorema 1: Implementação: S

3 O latch RS/Outras implementações Teoremas de DeMorgan: Teorema 2: Implementação: É possível ? O que muda ? S S

4 O latch RS Controlado

5 O latch RS Controlado/Simulação

6 Simulação/Estudo de caso Ruído Não afeta saída Ruído Não afeta saída

7

8 Descrição Verilog/Latch RS controlado Símbolo do Latch RS Controlado module latch_rs_controlado (output reg q, qinv, input c, r, s); begin if (c = =1) begin if (r == 1 & s = = 0) begin q = 0; qinv = 1; end else if (r = = 0 & s = = 1) begin q = 1; qinv = 0; end endmodule

9 O latch RS Controlado com SET e RESET Assíncronos

10 reset assíncrono set assíncrono O latch RS com SET e RESET Assíncronos/Simulação

11 Símbolo

12 O latch D TABELA DE TRANSIÇÃO LATCH RS CONTROLADOTABELA DE TRANSIÇÃO LATCH D

13 O latch D TABELA DE TRANSIÇÃO LATCH D

14 Descrição e Simulação latch D module latch_tipoD (output reg q, qinv, input c, d); begin if (c = =1)begin q = d; qinv = !d; end endmodule

15 latch tipo D module latch_tipoD_sem_qinv (output reg q, input c, d); begin if (c = =1)begin q = d; end endmodule Descrição RTL

16 latch tipo D module latch_tipoD (output reg q, qinv, input c, d); begin if (c= =1)begin q = d; qinv = !d; end endmodule Descrição RTL

17 Latches com ativação em lógica complementar

18 Célula LATCH da ALTERA


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