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Arquitetura AMD 64 Família de 64 bits da AMD Trabalho feito por : Fábio Sogumo Felipe Wolff Ramos Flávio Ivan da Silva.

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Apresentação em tema: "Arquitetura AMD 64 Família de 64 bits da AMD Trabalho feito por : Fábio Sogumo Felipe Wolff Ramos Flávio Ivan da Silva."— Transcrição da apresentação:

1 Arquitetura AMD 64 Família de 64 bits da AMD Trabalho feito por : Fábio Sogumo Felipe Wolff Ramos Flávio Ivan da Silva

2 Visão geral AMD 64 - Hammer Permite o uso de programas e sistemas operacionais 32 bits de forma nativa Possibilidade de transição para 64 bits Implementado no Athlon TM e no Opteron TM.

3 Visão geral AMD 64 - Hammer 16 registradores de uso geral com 64 bits 8 registradores MMX/Ponto flutuante com 64 bits 16 registradores XMM de 128 bits Suporte a arquitetura Intel de 16 e de 32 bits

4 Modos de operação 64 bit mode Modo 64 bits! Compatibility mode 64 bits com suporte para programas de 32 bits Long Mode

5 Modos de operação Protected mode Virtual 8086-mode Real Mode Legacy Mode

6 Registradores 8 novos registradores de propósito geral – R8 a R15 8 novos registradores XMM de 128 bits Registradores RIP e RSP expandidos para 64 bits Em comparação à arquitetura x86 de 32 bits:

7 Registradores

8 Memória Modo 64-bit Modo de compatibilidade

9 Memória Registradores de segmento (CS, DS e SS) ignorados. Flat Segmentation Model – Memória tratada como um único vetor Modo 64-bit

10 Memória Compatibilidade total com o x86 Utiliza segmentação de memória Modo de compatibilidade

11 Conjunto de Instruções Instruções de propósito geral Instruções de media para os registradores de 128 bits Instruções de media para os registradores de 64 bits Instruções de ponto flutuante – x87

12 Novidades do AMD 64 Tecnologia CoolnQuiet Enhanced Virus Protection Capacidade de mudança da frequência e voltagem de operação da CPU on demand. Implementado o bit NX (No eXecute) nas tabelas de páginas.

13 Arquitetura do AMD 64

14 Uma visão mais aprofundada

15 A cache no AMD 64 Cache L1 com 128KB Cache L2 com 512KB ou 1MB Cache L1 de dados com 64KB Cache L1 de instruções com 64KB

16 A cache no AMD 64 Cache L1 CaracterísticaAMD 64 Organização da cacheCaches de instruções e de dados separadas Tamanho da cache64KB para cada uma Associatividade da cache2-way Tamanho do Bloco64 bytes Política de escritaWrite-back

17 A cache no AMD 64 CaracterísticaAMD 64 Organização da cacheUma única cache para instruções e dados Tamanho da cache1MB ou 512KB Associatividade da cache16-way Tamanho do Bloco64 bytes Política de escritaWrite-back Cache L2

18 Tecnologia HyperTransport Comunicação de alta velocidade entre: Comunicação bidirecional com capacidade de até 3,2GB/s CPU e chipset CPU e dispositivos de E/S CPUs no caso de sistema multi-processado

19 Tecnologia HyperTransport

20 Integrated Memory Controller Controlador de memória embutido no processador Maior velocidade na requisição de dados para a memória Aumento de performance do controlador à medida que o clock da CPU aumenta

21 Integrated Memory Controller Arquitetura mais comum: Controlador no chipset da placa mãe Arquitetura AMD 64: Controlador na própria CPU

22 Branch Prediction Classificação dos branches: Bits na cache L1 Indicam a localização dos branches Indicam o tipo dos branches Branch estático : branches de fácil previsibilidade. Ex: (branches para códigos de tratamento de erros) Branch dinâmico : branches de difícil previsibilidade

23 Perguntas Obrigado pela presença!


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