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Hardware Description Language Aula 4 -VHDL Prof. Afonso Ferreira Miguel, MSc
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VHDL Máquinas de estado de MOORE e0/0 e1/1 1 0 1 0 Definição dos estados
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VHDL Máquinas de estado de MOORE e0/0 e1/1 1 0 1 0 Definição das transições
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VHDL Máquinas de estado e0/0 e1/1 1 0 1 0 Definição dos valores de saída
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Exercício 1 –Implementar em VHDL uma máquina de estados (Moore) que realize a função de um detector de 3 uns consecutivos não reaproveitando os valores de uma seqüência previamente detectada.
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Exercício 2 –Implementar em VHDL uma máquina de estado de MOORE com 4 bits de entrada (+ o clock) e 1 bit de saída. O bit de saída inicialmente deve apresentar o valor ZERO, e deve ir para UM quando receber na entrada o valor 15. Caso ele receba a seqüência 7, 4, 3 a máquina deve voltar ao seu estado inicial ZERO.
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